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scsi: hisi_sas: add phy up/down/bcast and channel ISR
Add code to initialise interrupts and add some interrupt handlers. Also add function hisi_sas_v3_destroy_irqs() to clean-up irqs upon module unloading. Signed-off-by: John Garry <john.garry@huawei.com> Signed-off-by: Xiang Chen <chenxiang66@hisilicon.com> Signed-off-by: Martin K. Petersen <martin.petersen@oracle.com>
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Xiang Chen
Martin K. Petersen
parent
3975f6054e
commit
54edeee1e1
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@ -173,6 +173,13 @@ enum {
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HISI_SAS_PHY_INT_NR
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HISI_SAS_PHY_INT_NR
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};
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};
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static u32 hisi_sas_read32(struct hisi_hba *hisi_hba, u32 off)
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{
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void __iomem *regs = hisi_hba->regs + off;
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return readl(regs);
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}
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static void hisi_sas_write32(struct hisi_hba *hisi_hba, u32 off, u32 val)
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static void hisi_sas_write32(struct hisi_hba *hisi_hba, u32 off, u32 val)
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{
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{
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void __iomem *regs = hisi_hba->regs + off;
|
void __iomem *regs = hisi_hba->regs + off;
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@ -397,6 +404,269 @@ static void sl_notify_v3_hw(struct hisi_hba *hisi_hba, int phy_no)
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hisi_sas_phy_write32(hisi_hba, phy_no, SL_CONTROL, sl_control);
|
hisi_sas_phy_write32(hisi_hba, phy_no, SL_CONTROL, sl_control);
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}
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}
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static int phy_up_v3_hw(int phy_no, struct hisi_hba *hisi_hba)
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{
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int i, res = 0;
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u32 context, port_id, link_rate, hard_phy_linkrate;
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struct hisi_sas_phy *phy = &hisi_hba->phy[phy_no];
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struct asd_sas_phy *sas_phy = &phy->sas_phy;
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struct device *dev = hisi_hba->dev;
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hisi_sas_phy_write32(hisi_hba, phy_no, PHYCTRL_PHY_ENA_MSK, 1);
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port_id = hisi_sas_read32(hisi_hba, PHY_PORT_NUM_MA);
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port_id = (port_id >> (4 * phy_no)) & 0xf;
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link_rate = hisi_sas_read32(hisi_hba, PHY_CONN_RATE);
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link_rate = (link_rate >> (phy_no * 4)) & 0xf;
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if (port_id == 0xf) {
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dev_err(dev, "phyup: phy%d invalid portid\n", phy_no);
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res = IRQ_NONE;
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goto end;
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}
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sas_phy->linkrate = link_rate;
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hard_phy_linkrate = hisi_sas_phy_read32(hisi_hba, phy_no,
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HARD_PHY_LINKRATE);
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phy->maximum_linkrate = hard_phy_linkrate & 0xf;
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phy->minimum_linkrate = (hard_phy_linkrate >> 4) & 0xf;
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phy->phy_type &= ~(PORT_TYPE_SAS | PORT_TYPE_SATA);
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/* Check for SATA dev */
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context = hisi_sas_read32(hisi_hba, PHY_CONTEXT);
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if (context & (1 << phy_no)) {
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struct hisi_sas_initial_fis *initial_fis;
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struct dev_to_host_fis *fis;
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u8 attached_sas_addr[SAS_ADDR_SIZE] = {0};
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dev_info(dev, "phyup: phy%d link_rate=%d\n", phy_no, link_rate);
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initial_fis = &hisi_hba->initial_fis[phy_no];
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|
fis = &initial_fis->fis;
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|
sas_phy->oob_mode = SATA_OOB_MODE;
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attached_sas_addr[0] = 0x50;
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attached_sas_addr[7] = phy_no;
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|
memcpy(sas_phy->attached_sas_addr,
|
||||||
|
attached_sas_addr,
|
||||||
|
SAS_ADDR_SIZE);
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||||||
|
memcpy(sas_phy->frame_rcvd, fis,
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|
sizeof(struct dev_to_host_fis));
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|
phy->phy_type |= PORT_TYPE_SATA;
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||||||
|
phy->identify.device_type = SAS_SATA_DEV;
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||||||
|
phy->frame_rcvd_size = sizeof(struct dev_to_host_fis);
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||||||
|
phy->identify.target_port_protocols = SAS_PROTOCOL_SATA;
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} else {
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|
u32 *frame_rcvd = (u32 *)sas_phy->frame_rcvd;
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struct sas_identify_frame *id =
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(struct sas_identify_frame *)frame_rcvd;
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|
dev_info(dev, "phyup: phy%d link_rate=%d\n", phy_no, link_rate);
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for (i = 0; i < 6; i++) {
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|
u32 idaf = hisi_sas_phy_read32(hisi_hba, phy_no,
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|
RX_IDAF_DWORD0 + (i * 4));
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||||||
|
frame_rcvd[i] = __swab32(idaf);
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||||||
|
}
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||||||
|
sas_phy->oob_mode = SAS_OOB_MODE;
|
||||||
|
memcpy(sas_phy->attached_sas_addr,
|
||||||
|
&id->sas_addr,
|
||||||
|
SAS_ADDR_SIZE);
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|
phy->phy_type |= PORT_TYPE_SAS;
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|
phy->identify.device_type = id->dev_type;
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|
phy->frame_rcvd_size = sizeof(struct sas_identify_frame);
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if (phy->identify.device_type == SAS_END_DEVICE)
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|
phy->identify.target_port_protocols =
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|
SAS_PROTOCOL_SSP;
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else if (phy->identify.device_type != SAS_PHY_UNUSED)
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|
phy->identify.target_port_protocols =
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|
SAS_PROTOCOL_SMP;
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}
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|
phy->port_id = port_id;
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|
phy->phy_attached = 1;
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queue_work(hisi_hba->wq, &phy->phyup_ws);
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|
end:
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hisi_sas_phy_write32(hisi_hba, phy_no, CHL_INT0,
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|
CHL_INT0_SL_PHY_ENABLE_MSK);
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|
hisi_sas_phy_write32(hisi_hba, phy_no, PHYCTRL_PHY_ENA_MSK, 0);
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|
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|
return res;
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|
}
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|
static int phy_down_v3_hw(int phy_no, struct hisi_hba *hisi_hba)
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{
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|
int res = 0;
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|
u32 phy_state, sl_ctrl, txid_auto;
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|
struct device *dev = hisi_hba->dev;
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|
hisi_sas_phy_write32(hisi_hba, phy_no, PHYCTRL_NOT_RDY_MSK, 1);
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|
phy_state = hisi_sas_read32(hisi_hba, PHY_STATE);
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|
dev_info(dev, "phydown: phy%d phy_state=0x%x\n", phy_no, phy_state);
|
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|
hisi_sas_phy_down(hisi_hba, phy_no, (phy_state & 1 << phy_no) ? 1 : 0);
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|
sl_ctrl = hisi_sas_phy_read32(hisi_hba, phy_no, SL_CONTROL);
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||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, SL_CONTROL,
|
||||||
|
sl_ctrl&(~SL_CTA_MSK));
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|
|
||||||
|
txid_auto = hisi_sas_phy_read32(hisi_hba, phy_no, TXID_AUTO);
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, TXID_AUTO,
|
||||||
|
txid_auto | CT3_MSK);
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||||||
|
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, CHL_INT0, CHL_INT0_NOT_RDY_MSK);
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, PHYCTRL_NOT_RDY_MSK, 0);
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||||||
|
|
||||||
|
return res;
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|
}
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static void phy_bcast_v3_hw(int phy_no, struct hisi_hba *hisi_hba)
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|
{
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|
struct hisi_sas_phy *phy = &hisi_hba->phy[phy_no];
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||||||
|
struct asd_sas_phy *sas_phy = &phy->sas_phy;
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||||||
|
struct sas_ha_struct *sas_ha = &hisi_hba->sha;
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||||||
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||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, SL_RX_BCAST_CHK_MSK, 1);
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||||||
|
sas_ha->notify_port_event(sas_phy, PORTE_BROADCAST_RCVD);
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, CHL_INT0,
|
||||||
|
CHL_INT0_SL_RX_BCST_ACK_MSK);
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no, SL_RX_BCAST_CHK_MSK, 0);
|
||||||
|
}
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|
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|
static irqreturn_t int_phy_up_down_bcast_v3_hw(int irq_no, void *p)
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{
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struct hisi_hba *hisi_hba = p;
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||||||
|
u32 irq_msk;
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int phy_no = 0;
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|
irqreturn_t res = IRQ_NONE;
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||||||
|
irq_msk = hisi_sas_read32(hisi_hba, CHNL_INT_STATUS)
|
||||||
|
& 0x11111111;
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||||||
|
while (irq_msk) {
|
||||||
|
if (irq_msk & 1) {
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||||||
|
u32 irq_value = hisi_sas_phy_read32(hisi_hba, phy_no,
|
||||||
|
CHL_INT0);
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||||||
|
u32 phy_state = hisi_sas_read32(hisi_hba, PHY_STATE);
|
||||||
|
int rdy = phy_state & (1 << phy_no);
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||||||
|
|
||||||
|
if (rdy) {
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||||||
|
if (irq_value & CHL_INT0_SL_PHY_ENABLE_MSK)
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||||||
|
/* phy up */
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||||||
|
if (phy_up_v3_hw(phy_no, hisi_hba)
|
||||||
|
== IRQ_HANDLED)
|
||||||
|
res = IRQ_HANDLED;
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||||||
|
if (irq_value & CHL_INT0_SL_RX_BCST_ACK_MSK)
|
||||||
|
/* phy bcast */
|
||||||
|
phy_bcast_v3_hw(phy_no, hisi_hba);
|
||||||
|
} else {
|
||||||
|
if (irq_value & CHL_INT0_NOT_RDY_MSK)
|
||||||
|
/* phy down */
|
||||||
|
if (phy_down_v3_hw(phy_no, hisi_hba)
|
||||||
|
== IRQ_HANDLED)
|
||||||
|
res = IRQ_HANDLED;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
irq_msk >>= 4;
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||||||
|
phy_no++;
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||||||
|
}
|
||||||
|
|
||||||
|
return res;
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||||||
|
}
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||||||
|
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|
static irqreturn_t int_chnl_int_v3_hw(int irq_no, void *p)
|
||||||
|
{
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||||||
|
struct hisi_hba *hisi_hba = p;
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||||||
|
struct device *dev = hisi_hba->dev;
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u32 ent_msk, ent_tmp, irq_msk;
|
||||||
|
int phy_no = 0;
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||||||
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||||||
|
ent_msk = hisi_sas_read32(hisi_hba, ENT_INT_SRC_MSK3);
|
||||||
|
ent_tmp = ent_msk;
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||||||
|
ent_msk |= ENT_INT_SRC_MSK3_ENT95_MSK_MSK;
|
||||||
|
hisi_sas_write32(hisi_hba, ENT_INT_SRC_MSK3, ent_msk);
|
||||||
|
|
||||||
|
irq_msk = hisi_sas_read32(hisi_hba, CHNL_INT_STATUS)
|
||||||
|
& 0xeeeeeeee;
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||||||
|
|
||||||
|
while (irq_msk) {
|
||||||
|
u32 irq_value0 = hisi_sas_phy_read32(hisi_hba, phy_no,
|
||||||
|
CHL_INT0);
|
||||||
|
u32 irq_value1 = hisi_sas_phy_read32(hisi_hba, phy_no,
|
||||||
|
CHL_INT1);
|
||||||
|
u32 irq_value2 = hisi_sas_phy_read32(hisi_hba, phy_no,
|
||||||
|
CHL_INT2);
|
||||||
|
|
||||||
|
if ((irq_msk & (4 << (phy_no * 4))) &&
|
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irq_value1) {
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||||||
|
if (irq_value1 & (CHL_INT1_DMAC_RX_ECC_ERR_MSK |
|
||||||
|
CHL_INT1_DMAC_TX_ECC_ERR_MSK))
|
||||||
|
panic("%s: DMAC RX/TX ecc bad error! (0x%x)",
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||||||
|
dev_name(dev), irq_value1);
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||||||
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||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no,
|
||||||
|
CHL_INT1, irq_value1);
|
||||||
|
}
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||||||
|
|
||||||
|
if (irq_msk & (8 << (phy_no * 4)) && irq_value2)
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no,
|
||||||
|
CHL_INT2, irq_value2);
|
||||||
|
|
||||||
|
|
||||||
|
if (irq_msk & (2 << (phy_no * 4)) && irq_value0) {
|
||||||
|
hisi_sas_phy_write32(hisi_hba, phy_no,
|
||||||
|
CHL_INT0, irq_value0
|
||||||
|
& (~CHL_INT0_HOTPLUG_TOUT_MSK)
|
||||||
|
& (~CHL_INT0_SL_PHY_ENABLE_MSK)
|
||||||
|
& (~CHL_INT0_NOT_RDY_MSK));
|
||||||
|
}
|
||||||
|
irq_msk &= ~(0xe << (phy_no * 4));
|
||||||
|
phy_no++;
|
||||||
|
}
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||||||
|
|
||||||
|
hisi_sas_write32(hisi_hba, ENT_INT_SRC_MSK3, ent_tmp);
|
||||||
|
|
||||||
|
return IRQ_HANDLED;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int interrupt_init_v3_hw(struct hisi_hba *hisi_hba)
|
||||||
|
{
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||||||
|
struct device *dev = hisi_hba->dev;
|
||||||
|
struct pci_dev *pdev = hisi_hba->pci_dev;
|
||||||
|
int vectors, rc;
|
||||||
|
int max_msi = HISI_SAS_MSI_COUNT_V3_HW;
|
||||||
|
|
||||||
|
vectors = pci_alloc_irq_vectors(hisi_hba->pci_dev, 1,
|
||||||
|
max_msi, PCI_IRQ_MSI);
|
||||||
|
if (vectors < max_msi) {
|
||||||
|
dev_err(dev, "could not allocate all msi (%d)\n", vectors);
|
||||||
|
return -ENOENT;
|
||||||
|
}
|
||||||
|
|
||||||
|
rc = devm_request_irq(dev, pci_irq_vector(pdev, 1),
|
||||||
|
int_phy_up_down_bcast_v3_hw, 0,
|
||||||
|
DRV_NAME " phy", hisi_hba);
|
||||||
|
if (rc) {
|
||||||
|
dev_err(dev, "could not request phy interrupt, rc=%d\n", rc);
|
||||||
|
rc = -ENOENT;
|
||||||
|
goto free_irq_vectors;
|
||||||
|
}
|
||||||
|
|
||||||
|
rc = devm_request_irq(dev, pci_irq_vector(pdev, 2),
|
||||||
|
int_chnl_int_v3_hw, 0,
|
||||||
|
DRV_NAME " channel", hisi_hba);
|
||||||
|
if (rc) {
|
||||||
|
dev_err(dev, "could not request chnl interrupt, rc=%d\n", rc);
|
||||||
|
rc = -ENOENT;
|
||||||
|
goto free_phy_irq;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
|
||||||
|
free_phy_irq:
|
||||||
|
free_irq(pci_irq_vector(pdev, 1), hisi_hba);
|
||||||
|
free_irq_vectors:
|
||||||
|
pci_free_irq_vectors(pdev);
|
||||||
|
return rc;
|
||||||
|
}
|
||||||
|
|
||||||
static int hisi_sas_v3_init(struct hisi_hba *hisi_hba)
|
static int hisi_sas_v3_init(struct hisi_hba *hisi_hba)
|
||||||
{
|
{
|
||||||
int rc;
|
int rc;
|
||||||
|
|
@ -405,6 +675,10 @@ static int hisi_sas_v3_init(struct hisi_hba *hisi_hba)
|
||||||
if (rc)
|
if (rc)
|
||||||
return rc;
|
return rc;
|
||||||
|
|
||||||
|
rc = interrupt_init_v3_hw(hisi_hba);
|
||||||
|
if (rc)
|
||||||
|
return rc;
|
||||||
|
|
||||||
return 0;
|
return 0;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
@ -563,6 +837,14 @@ hisi_sas_v3_probe(struct pci_dev *pdev, const struct pci_device_id *id)
|
||||||
return rc;
|
return rc;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
static void
|
||||||
|
hisi_sas_v3_destroy_irqs(struct pci_dev *pdev, struct hisi_hba *hisi_hba)
|
||||||
|
{
|
||||||
|
free_irq(pci_irq_vector(pdev, 1), hisi_hba);
|
||||||
|
free_irq(pci_irq_vector(pdev, 2), hisi_hba);
|
||||||
|
pci_free_irq_vectors(pdev);
|
||||||
|
}
|
||||||
|
|
||||||
static void hisi_sas_v3_remove(struct pci_dev *pdev)
|
static void hisi_sas_v3_remove(struct pci_dev *pdev)
|
||||||
{
|
{
|
||||||
struct device *dev = &pdev->dev;
|
struct device *dev = &pdev->dev;
|
||||||
|
|
@ -573,6 +855,7 @@ static void hisi_sas_v3_remove(struct pci_dev *pdev)
|
||||||
sas_remove_host(sha->core.shost);
|
sas_remove_host(sha->core.shost);
|
||||||
|
|
||||||
hisi_sas_free(hisi_hba);
|
hisi_sas_free(hisi_hba);
|
||||||
|
hisi_sas_v3_destroy_irqs(pdev, hisi_hba);
|
||||||
pci_release_regions(pdev);
|
pci_release_regions(pdev);
|
||||||
pci_disable_device(pdev);
|
pci_disable_device(pdev);
|
||||||
}
|
}
|
||||||
|
|
|
||||||
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