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staging: mt7621-pci: move some code into 'mt7621_pcie_init_ports'
Some clocks bits related code is in driver probe function and can perfectly be moved into 'mt7621_pcie_init_ports' function which is a more accurate place for it. Signed-off-by: Sergio Paracuellos <sergio.paracuellos@gmail.com> Signed-off-by: Greg Kroah-Hartman <gregkh@linuxfoundation.org>
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802a2f7b2f
commit
b8d97d43bf
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@ -626,6 +626,14 @@ static void mt7621_pcie_init_ports(struct mt7621_pcie *pcie)
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list_del(&port->list);
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}
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}
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rt_sysc_m32(0, RALINK_PCIE_RST, RALINK_RSTCTRL);
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rt_sysc_m32(0x30, 2 << 4, SYSC_REG_SYSTEM_CONFIG1);
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rt_sysc_m32(PCIE_CLK_GEN_EN, PCIE_CLK_GEN_DIS, RALINK_PCIE_CLK_GEN);
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rt_sysc_m32(PCIE_CLK_GEN1_DIS, PCIE_CLK_GEN1_EN, RALINK_PCIE_CLK_GEN1);
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rt_sysc_m32(PCIE_CLK_GEN_DIS, PCIE_CLK_GEN_EN, RALINK_PCIE_CLK_GEN);
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mdelay(50);
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rt_sysc_m32(RALINK_PCIE_RST, 0, RALINK_RSTCTRL);
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}
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static int mt7621_pcie_enable_port(struct mt7621_pcie_port *port)
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@ -833,16 +841,6 @@ static int mt7621_pci_probe(struct platform_device *pdev)
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mt7621_pcie_init_ports(pcie);
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rt_sysc_m32(0, RALINK_PCIE_RST, RALINK_RSTCTRL);
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rt_sysc_m32(0x30, 2 << 4, SYSC_REG_SYSTEM_CONFIG1);
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rt_sysc_m32(PCIE_CLK_GEN_EN, PCIE_CLK_GEN_DIS, RALINK_PCIE_CLK_GEN);
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rt_sysc_m32(PCIE_CLK_GEN1_DIS, PCIE_CLK_GEN1_EN, RALINK_PCIE_CLK_GEN1);
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rt_sysc_m32(PCIE_CLK_GEN_DIS, PCIE_CLK_GEN_EN, RALINK_PCIE_CLK_GEN);
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mdelay(50);
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rt_sysc_m32(RALINK_PCIE_RST, 0, RALINK_RSTCTRL);
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err = mt7621_pcie_init_virtual_bridges(pcie);
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if (err) {
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dev_err(dev, "Nothing is connected in virtual bridges. Exiting...");
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