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tcg/ppc: Handle ctpop opcode
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14e99210f6
commit
33e75fb9c8
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@ -49,6 +49,7 @@ typedef enum {
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TCG_AREG0 = TCG_REG_R27
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} TCGReg;
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extern bool have_isa_2_06;
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extern bool have_isa_3_00;
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/* optional instructions automatically implemented */
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@ -72,7 +73,7 @@ extern bool have_isa_3_00;
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#define TCG_TARGET_HAS_nor_i32 1
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#define TCG_TARGET_HAS_clz_i32 1
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#define TCG_TARGET_HAS_ctz_i32 have_isa_3_00
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#define TCG_TARGET_HAS_ctpop_i32 0
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#define TCG_TARGET_HAS_ctpop_i32 have_isa_2_06
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#define TCG_TARGET_HAS_deposit_i32 1
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#define TCG_TARGET_HAS_extract_i32 1
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#define TCG_TARGET_HAS_sextract_i32 0
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@ -108,7 +109,7 @@ extern bool have_isa_3_00;
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#define TCG_TARGET_HAS_nor_i64 1
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#define TCG_TARGET_HAS_clz_i64 1
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#define TCG_TARGET_HAS_ctz_i64 have_isa_3_00
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#define TCG_TARGET_HAS_ctpop_i64 0
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#define TCG_TARGET_HAS_ctpop_i64 have_isa_2_06
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||||
#define TCG_TARGET_HAS_deposit_i64 1
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||||
#define TCG_TARGET_HAS_extract_i64 1
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||||
#define TCG_TARGET_HAS_sextract_i64 0
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@ -83,7 +83,7 @@ static tcg_insn_unit *tb_ret_addr;
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#include "elf.h"
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static bool have_isa_2_06;
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bool have_isa_2_06;
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bool have_isa_3_00;
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#define HAVE_ISA_2_06 have_isa_2_06
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@ -457,6 +457,8 @@ static int tcg_target_const_match(tcg_target_long val, TCGType type,
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#define CNTLZD XO31( 58)
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#define CNTTZW XO31(538)
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#define CNTTZD XO31(570)
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#define CNTPOPW XO31(378)
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#define CNTPOPD XO31(506)
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#define ANDC XO31( 60)
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#define ORC XO31(412)
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#define EQV XO31(284)
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@ -2149,6 +2151,9 @@ static void tcg_out_op(TCGContext *s, TCGOpcode opc, const TCGArg *args,
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tcg_out_cntxz(s, TCG_TYPE_I32, CNTTZW, args[0], args[1],
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args[2], const_args[2]);
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break;
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case INDEX_op_ctpop_i32:
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tcg_out32(s, CNTPOPW | SAB(args[1], args[0], 0));
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break;
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case INDEX_op_clz_i64:
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||||
tcg_out_cntxz(s, TCG_TYPE_I64, CNTLZD, args[0], args[1],
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@ -2158,6 +2163,9 @@ static void tcg_out_op(TCGContext *s, TCGOpcode opc, const TCGArg *args,
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|||
tcg_out_cntxz(s, TCG_TYPE_I64, CNTTZD, args[0], args[1],
|
||||
args[2], const_args[2]);
|
||||
break;
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||||
case INDEX_op_ctpop_i64:
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tcg_out32(s, CNTPOPD | SAB(args[1], args[0], 0));
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||||
break;
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case INDEX_op_mul_i32:
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a0 = args[0], a1 = args[1], a2 = args[2];
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@ -2573,6 +2581,7 @@ static const TCGTargetOpDef ppc_op_defs[] = {
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{ INDEX_op_nor_i32, { "r", "r", "r" } },
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||||
{ INDEX_op_clz_i32, { "r", "r", "rZW" } },
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||||
{ INDEX_op_ctz_i32, { "r", "r", "rZW" } },
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||||
{ INDEX_op_ctpop_i32, { "r", "r" } },
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|
||||
{ INDEX_op_shl_i32, { "r", "r", "ri" } },
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||||
{ INDEX_op_shr_i32, { "r", "r", "ri" } },
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@ -2623,6 +2632,7 @@ static const TCGTargetOpDef ppc_op_defs[] = {
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|||
{ INDEX_op_nor_i64, { "r", "r", "r" } },
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||||
{ INDEX_op_clz_i64, { "r", "r", "rZW" } },
|
||||
{ INDEX_op_ctz_i64, { "r", "r", "rZW" } },
|
||||
{ INDEX_op_ctpop_i64, { "r", "r" } },
|
||||
|
||||
{ INDEX_op_shl_i64, { "r", "r", "ri" } },
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||||
{ INDEX_op_shr_i64, { "r", "r", "ri" } },
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